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    一種框架外露多芯片混裝堆疊夾芯封裝結構制造技術

    技術編號:15154073 閱讀:145 留言:0更新日期:2017-04-11 20:46
    本實用新型專利技術涉及一種框架外露多芯片混裝堆疊夾芯封裝結構,它包括第一引線框(21)、第二引線框(22)、第三引線框(23)、第一芯片(24)和第二芯片(25),所述第一芯片(24)夾設在第一引線框(21)與第二引線框(22)之間,所述第一芯片(24)背面配置于所述第一引線框(21)上,所述第二芯片(25)夾設在第二引線框(22)與第三引線框(23)之間,所述第二芯片(25)正面配置于所述第一上水平段(221)上,所述第一引線框(21)、第一下水平段(223)和第二下水平段(233)的下表面齊平。本實用新型專利技術的有益效果是:具有較低的封裝電阻和封裝電感,具有較好的散熱性,整條產品一體成型,生產效率高。

    【技術實現步驟摘要】

    本技術涉及一種框架外露多芯片混裝堆疊夾芯封裝結構,屬于半導體封裝

    技術介紹
    近年來,隨著電子產品對功率密度不斷的追求,無論是Diode(二級管)還是Transistor(三極管)的封裝,尤其是Transistor中的MOS產品正朝著更大功率、更小尺寸、更快速、散熱更好的趨勢在發展。封裝的一次性制造方式也由單顆封裝技術慢慢朝向小區域甚至更大區域的高密度高難度低成本一次性封裝技術沖刺與挑戰。因此,也對MOS產品的封裝在寄生的電阻、電容、電感等的各種電性能、封裝的結構、封裝的熱消散性能力、封裝的信賴性方面以及高難度一次性封裝技術方面有了更多的要求。傳統的Diode(二級管)以及Transistor(三極管)或是MOS產品的封裝一般依據產品特性、功率的不同以及成本的考慮因素,利用了金線、銀合金線、銅線、鋁線以及鋁帶的焊線方式作為芯片與內引腳的主要的互聯技術,從而實現電氣連接。然而焊線的技術方式對產品的性能存在了以下幾個方面的限制與缺陷:一、封裝與制造方面的限制與缺陷:1)、焊接能力(Bondability)方面:常常會因為金屬絲材料、金屬引腳材料的變化以及設備與工具的參數片變化、性能與精度的變化以及保養與校正管理而造成的第一焊點以及第二焊點結合面的虛焊、脫落、斷點、頸部裂縫、塌線以及短路等種種的困擾,導致了封裝良率無法提升、成本無法下降、可靠性的不穩定;2)、一次性高密度封裝技術方面:傳統的互聯方式幾乎都是在矩陣型金屬引線框上采用單顆芯片一顆一顆芯片重復進行裝片、金屬絲采高溫超聲一根線一根線的焊接方式。而這樣情況下無論是專業的裝片機、球焊打線機、鍵合鋁線/鋁帶機或是銅片搭接機等機器設備再高速的重復動作都無法提升生產效率、無法降低單位成本,也因為設備不斷的提升生產速度同樣的也提升了制造的不穩定性。二、封裝產品的特性能方面的限制與缺陷:1)、熱消散方面:傳統的Diode(二級管)以及Transistor(三極管)或是MOS的封裝產品,一般都是由塑封料包覆、只留外部引腳暴露在塑封體之外,由于塑封料本身不是一種熱導的物質,所以傳統的Diode(二級管)以及Transistor(三極管)或是MOS產品在工作時所產生的熱量很難通過塑封料消散出塑封料物質的封裝體,只能依靠細細的金屬絲互聯在金屬引腳材料來幫助熱能的消散,但是這種熱消散的途徑對熱的消散能力是非常有限的,反而形成熱消散的阻力;2)、電阻率(Resistivity)方面:大家都知道電阻率(resistivity)是用來表示各種物質電阻特性的物理量。在溫度一定的情況下,有公式R=ρl/s其中的ρ就是電阻率,l為材料的長度,s為面積。可以看出,材料的電阻大小正比于材料的長度,而反比于其面積。由上式可知電阻率的定義:ρ=Rs/l。傳統的Diode(二級管)以及Transistor(三極管)或是MOS的封裝產品,采用焊線形成互聯,由此可清楚的知道用來執行電源或是信號的金屬絲會因為,導體材料的長度與截面積的變化而影響到電阻率的大小以及接觸電阻的損耗,尤其是應用在功率方面的產品影響更是明顯。為解決上述問題,業界對傳統的Diode(二級管)以及Transistor(三極管)或是MOS的封裝產品進行了改進,用金屬帶、金屬夾板代替焊線,來降低封裝電阻、電感與期望改善熱消散的能力。如圖1所示,為一種現有的MOS堆疊封裝結構,此結構中引線框11包含管芯焊盤和引腳,在引線框11的管芯焊盤上植入第一芯片12。第一芯片12的源極通過第一金屬夾板14電耦合至引腳,第一芯片12的柵極通過第一金屬焊線16電耦合至引腳。然后在第一金屬夾板14上植入第二芯片13,第二芯片13的源極通過第二金屬夾板15電耦合至引腳,第二芯片13的柵極通過第二金屬焊線17電耦合至引腳。再進行包封、切割、測試等后續工序。此MOS封裝結構用金屬夾板取代了傳統MOS封裝中的焊線,降低了部分封裝電阻,但是還是存在以下缺陷:1.)此MOS封裝結構中芯片的漏極、源極和柵極與引線框形成互聯分別要用到不同的設備,制程復雜,設備的購置成本較高。2.)此MOS封裝結構在把金屬夾板和金屬焊線耦合至芯片和引腳上時,只能一顆顆芯片進行,無法整條一體成型,制造效率較低。3.)此MOS封裝的內外引腳不是一體形成,而是通過焊料焊接而成,所以內外引腳結合處(即金屬夾板、金屬帶與引線框接觸處)仍存在較高的接觸電阻。4.)使用金屬夾板耦合于芯片和金屬引腳上時,因其芯片板圖不同或是芯片面積不同時,金屬夾板以及金屬夾板的沖切與搬運模具和機構,就必須要重新設計、重新制造,而這些變更往往會造成購置金錢的浪費、重新架構時間成本的浪費、商機成本的浪費以及人員配置的浪費。5.)使用金屬夾板耦合于芯片和金屬引腳上時,因其金屬夾板非常小在生產沖切、搬運以及在焊接過程中,常常發生金屬夾板運輸時掉落、焊接時傾倒以及焊接不良,倒致良率與可靠性的受損。
    技術實現思路
    本技術所要解決的技術問題是針對上述現有技術提供一種框架外露多芯片混裝堆疊夾芯封裝結構,其工藝簡單,生產成本較低,具有較低的封裝電阻和封裝電感,具有較好的散熱性,整條產品可一體成型,生產效率高。本技術解決上述問題所采用的技術方案為:一種框架外露多芯片混裝堆疊夾芯封裝結構,它包括第一引線框、第二引線框、第三引線框、第一芯片和第二芯片,所述第二引線框和第三引線框呈Z形,所述Z形的第二引線框包括第一上水平段、第一中間連接段和第一下水平段,所述Z形的第三引線框包括第二上水平段、第二中間連接段和第二下水平段,所述第一芯片夾設在第一引線框與第一上水平段之間,所述第一芯片背面配置于所述第一引線框上,所述第一芯片的背面和正面分別通過錫膏與第一引線框和第一上水平段電性連接,所述第二芯片夾設在第一上水平段與第二上水平段之間,所述第二芯片正面配置于所述第一上水平段上,所述第二芯片的正面和背面分別通過錫膏與第一上水平段和第二上水平段電性連接,所述第一引線框、第二引線框和第三引線框外包封有塑封料,所述第一引線框下表面、第一下水平段下表面和第二下水平段下表面齊平,所述第一引線框下表面、第一下水平段下表面、第二下水平段下表面以及第二上水平段上表面均暴露在塑封料之外。所述第一引線框、第二引線框和第三引線框的材質可以為合金銅材、純銅材、鋁鍍銅材、鋅鍍銅材、鎳鐵合金材,也可以為其它CTE范圍是8*10^-6/℃~25*10^-6/℃的導電材質。所述第一芯片和第二芯片為可以與金本文檔來自技高網
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    【技術保護點】
    一種框架外露多芯片混裝堆疊夾芯封裝結構,其特征在于:它包括第一引線框(21)、第二引線框(22)、第三引線框(23)、第一芯片(24)和第二芯片(25),所述第二引線框(22)和第三引線框(23)呈Z形,所述Z形的第二引線框(22)包括第一上水平段(221)、第一中間連接段(222)和第一下水平段(223),所述Z形的第三引線框(23)包括第二上水平段(231)、第二中間連接段(232)和第二下水平段(233),所述第一芯片(24)夾設在第一引線框(21)與第一上水平段(221)之間,所述第一芯片(24)背面配置于所述第一引線框(21)上,所述第一芯片(24)的背面和正面分別通過錫膏(26)與第一引線框(21)和第一上水平段(221)電性連接,所述第二芯片(25)夾設在第一上水平段(221)與第二上水平段(231)之間,所述第二芯片(25)正面配置于所述第一上水平段(221)上,所述第二芯片(25)的正面和背面分別通過錫膏(26)與第一上水平段(221)和第二上水平段(231)電性連接,所述第一引線框(21)、第二引線框(22)和第三引線框(23)外包封有塑封料(27),所述第一引線框(21)下表面、第一下水平段(223)下表面和第二下水平段(233)下表面齊平,所述第一引線框(21)下表面、第一下水平段(223)下表面、第二下水平段(233)下表面以及第二上水平段(231)上表面均暴露在塑封料之外。...

    【技術特征摘要】
    1.一種框架外露多芯片混裝堆疊夾芯封裝結構,其特征在于:它包括第一引線框(21)、
    第二引線框(22)、第三引線框(23)、第一芯片(24)和第二芯片(25),所述第二引線框(22)和
    第三引線框(23)呈Z形,所述Z形的第二引線框(22)包括第一上水平段(221)、第一中間連接
    段(222)和第一下水平段(223),所述Z形的第三引線框(23)包括第二上水平段(231)、第二
    中間連接段(232)和第二下水平段(233),所述第一芯片(24)夾設在第一引線框(21)與第一
    上水平段(221)之間,所述第一芯片(24)背面配置于所述第一引線框(21)上,所述第一芯片
    (24)的背面和正面分別通過錫膏(26)與第一引線框(21)和第一上水平段(221)電性連接,
    所述第二芯片(25)夾設在第一上水平段(221)與第二上水平段(231)之間,所述第二芯片
    (25)正面配置于所述第一上水平段(221)上,所述第二芯片(25)的正面和背面分別通過錫
    膏(26)與第一上水平段(221)和第二上水平段(231)電性連接,所述第一引線框(21)、第...

    【專利技術屬性】
    技術研發人員:劉愷梁志忠張波王亞琴
    申請(專利權)人:江蘇長電科技股份有限公司
    類型:新型
    國別省市:江蘇;32

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