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    一種接收器制造技術

    技術編號:15517271 閱讀:115 留言:0更新日期:2017-06-04 07:56
    本申請提供了一種接收器,包括:對齊控制單元、m路傳輸路徑、多路寄存選擇控制單元、符號脈沖產生器以及存儲單元。對齊控制單元用于產生包括相位值以及偏移值的對齊控制信號。多路寄存選擇控制單元用于依據相位值,產生m路傳輸路徑的選擇信號。m路傳輸路徑中的任意一條傳輸路徑在接收到的選擇信號為第一數值的情況下,輸出接收到的序列,在接收到的選擇信號為第二數值的情況下,將接收到的序列延遲一個采樣點后輸出。符號脈沖產生器用于將預先設置的脈沖發射時間延遲偏移值個采樣點后,發出脈沖信號。存儲單元用于在接收到所述脈沖信號后,存儲m路傳輸路徑輸出序列的拼接序列。接收器實現了序列的并行處理,因此能夠降低處理時延。

    【技術實現步驟摘要】
    一種接收器
    本申請涉及通信領域,尤其涉及一種接收器。
    技術介紹
    以正交頻分復用(OrthogonalFrequencyDivisionMultiplexing,OFDM)為原理的信道編解碼和調制解調方法已經廣泛應用在各種有線和無線通信領域上來,OFDM技術擁有頻譜利用率高,抵抗碼間串擾強等優勢,并且采用現代數字信號處理技術便于實現,也擁有低成本和低功耗的優勢。OFDM技術把整個系統可利用的頻譜劃分成很多子載波,每個子載波根據傳輸信道的好壞,可以承載不同的序列量。因此OFDM系統在啟動以后,需要在局端和終端建立一套握手和初始化的機制,來進行協議協商、信道發現訓練和參數交換,完成這些階段以后,才能進入序列業務互通階段。局端和終端在整個初始化機制中,需要確保序列傳輸以離散多載波(DiscreteMulti-Tone,DMT)邊界對齊的形式發送和接收,如果有偏差,會導致OFDM信號在接收側信號的信噪比降低甚至無法恢復。而現有的對齊方法,通常將接收到的至少兩個符號周期的序列全部存儲后,再進行對齊處理,然后再發給后續設備,因此具有較大的時延。
    技術實現思路
    本申請提供了一種接收器,目的在于解決現有的序列對齊方法時延大的問題。為了實現上述目的,本申請提供了以下技術方案:一種接收器,包括:對齊控制單元、m路傳輸路徑、多路寄存選擇控制單元、符號脈沖產生器以及存儲單元。所述對齊控制單元用于產生對齊控制信號,所述控制信號包括向所述多路寄存選擇控制單元發送的相位值,以及向所述符號脈沖產生器發送的偏移值,其中,S/m的整數部分加1為所述偏移值,S/m的余數部分為所述相位值,所述S為接收到的串行序列與預設的參考序列相比的時延偏移,所述接收到的串行序列被分為m路序列。所述多路寄存選擇控制單元用于依據所述相位值,產生所述m路傳輸路徑的選擇信號,所述m路傳輸路徑的選擇信號的二進制拼接值為2(m-P)-1,其中,P為所述相位值。所述m路傳輸路徑中的任意一條傳輸路徑用于傳輸所述m路序列中的一路序列,所述m路傳輸路徑中的任意一條傳輸路徑與其它傳輸路徑傳輸的序列不同。所述任意一條傳輸路徑在接收到的選擇信號為第一數值的情況下,輸出接收到的序列,在接收到的選擇信號為第二數值的情況下,將所述接收到的序列延遲一個采樣點后輸出。所述符號脈沖產生器用于將預先設置的脈沖發射時間延遲t個采樣點后,發出脈沖信號,t為所述偏移值。所述存儲單元用于在接收到所述脈沖信號后,存儲所述m路傳輸路徑輸出序列的拼接序列。可見,接收器使用m路傳輸路徑對序列進行時序調整,因此,實現了序列的并行處理,從而實現一個符號周期內的對齊處理,而無需等待至少兩個符號周期再進行對齊,因此能夠降低處理時延。并且,因為減少了符號的存儲量,因此,無需使用大容量的存儲器。進一步的,因為多路傳輸路徑的“微調”,還能夠有效降低局端或終端處理端的時鐘主頻,實現在不降低數據吞吐量的基礎上降低系統功耗。在一個實現方式中,所述存儲單元包括:第一存儲器、第二存儲器和偏置開關。所述偏置開關用于,在接收到所述脈沖信號后,從所述第一存儲器和第二存儲器中選擇目標存儲器,并將所述m路傳輸路徑輸出序列的拼接序列存儲到所述目標存儲器中。由于偏置開關的作用,序列被輪流存儲在第一存儲器和第二存儲器中,因此,在一個存儲器存儲序列的過程中,另一個存儲器中已存儲的序列可以先發給后續設備,從而加快處理速度。在一個實現方式中,還包括:拼接單元,用于將所述m路傳輸路徑輸出序列進行拼接,并將拼接后的序列發給所述存儲單元,拼接后的序列的長度不大于所述目標存儲器的位寬。在一個實現方式中,還包括:序列拆分單元,用于接收所述串行序列,并將所述串行序列平均分為m路序列。在一個實現方式中,所述對齊控制單元還用于:將所述存儲器輸出的序列作為所述接收到的串行序列,或者,從所述序列拆分單元得到所述接收到的串行序列。在一個實現方式中,所述對齊控制單元用于產生對齊控制信號包括:所述對齊控制單元具體用于,通過比較序列拆分單元接收到的序列與參考序列,得到兩者之間的時延偏移S,通過計算S/m,得到的結果的整數部分加1為偏移值,余數部分為相位值。附圖說明為了更清楚地說明本申請實施例或現有技術中的技術方案,下面將對實施例或現有技術描述中所需要使用的附圖作簡單地介紹,顯而易見地,下面描述中的附圖僅僅是本申請的一些實施例,對于本領域普通技術人員來講,在不付出創造性勞動的前提下,還可以根據這些附圖獲得其他的附圖。圖1為OFDM通信系統的示例圖;圖2為本申請實施例公開的一種接收器的結構示意圖;圖3為本申請實施例公開的接收器中的序列拆分單元的功能示意圖;圖4為本申請實施例公開的接收器中的對齊控制單元的工作流程圖;圖5為本申請實施例公開的接收器中的對齊控制單元獲取偏移值和相位值的示意圖;圖6為本申請實施例公開的接收器中的傳輸路徑的功能示意圖;圖7為本申請實施例公開的又一種接收器的結構示意圖;圖8為本申請實施例公開的接收器的功能效果圖。具體實施方式圖1為OFDM通信系統的一個示例,圖1中,局端與終端之間的通信介質包括銅質雙絞線,多端口布局采用矢量Vector技術用來抵消不同線間的各種串擾,該技術要求多端口在同一捆雙絞線收發時,要確保各個端口的離散多載波(DiscreteMulti-Tone,DMT)符號也是對齊的。圖1中,一個正弦波表示一個符號的時域序列,由于線長延遲不同,以及各個局端和終端內部處理的不同延遲,會使得局端或者終端在信道時域序列采樣時,多端口之間會有延遲。本申請提出了一種接收器,可以使用在圖1所示的終端或者局端中。目的在于,使得不同端口接收到的序列均與預先設置的參考序列對齊,以實現不同端口接收到的序列之間的對齊。下面將結合附圖,對本申請提出的接收器進行詳細的說明。圖2所示為本申請實施例提出的一種接收器,其中包括:序列拆分單元、對齊控制單元、m路傳輸路徑、多路寄存選擇控制單元、序列拼接單元、符號脈沖產生器、偏置開關以及存儲器0、存儲器1。圖2所示的接收器的工作過程包括:序列拆分單元在接收到序列(例如圖1所示的正弦波)后,將串行序列平均分為m路序列,并將m路序列發送到m路傳輸路徑上。其中,一路序列對應一條傳輸路徑。也就是說,m路傳輸路徑中的任意一條傳輸路徑傳輸的序列,與其它傳輸路徑傳輸的序列不同。舉例說明,如圖3所示,序列拆分單元串行接收到的序列為[4094,4095,0,1,2,3,4,5,.....4091,4092,4093](序列中的每一個數值均表示一個采樣點,在實際業務中,一個采樣點采樣Nbit數據),將其按照排列順序,每四個數值為一組進行分組,得到的序列分組分別為[4094,4095,0,1]、[2,3,4,5]、[6,7,8,9]、……[4090,4091,4092,4093],每一個分組中的第一個數值為第一路序列,被發送到第一路傳輸路徑,第二個數值為第二路序列,被發送到第二路傳輸路徑,依次類推,第四個數值為第四路序列,被發送到第四路傳輸路徑。需要說明的是,除了將串行序列平均分為m路序列之外,m路序列的長度也可以不同。例如,前m-1路序列的長度相同,而第m路序列的長度小于前m-1路序列的長度(可能因為接收到的序列不足以使得第m路序列與前m-1路序列一樣長)本文檔來自技高網...
    一種接收器

    【技術保護點】
    一種接收器,其特征在于,包括:對齊控制單元、m路傳輸路徑、多路寄存選擇控制單元、符號脈沖產生器以及存儲單元;所述對齊控制單元用于產生對齊控制信號,所述控制信號包括向所述多路寄存選擇控制單元發送的相位值,以及向所述符號脈沖產生器發送的偏移值,其中,S/m的整數部分加1為所述偏移值,S/m的余數部分為所述相位值,所述S為接收到的串行序列與預設的參考序列相比的時延偏移,所述接收到的串行序列被分為m路序列;所述多路寄存選擇控制單元用于依據所述相位值,產生所述m路傳輸路徑的選擇信號,所述m路傳輸路徑的選擇信號的二進制拼接值為2

    【技術特征摘要】
    1.一種接收器,其特征在于,包括:對齊控制單元、m路傳輸路徑、多路寄存選擇控制單元、符號脈沖產生器以及存儲單元;所述對齊控制單元用于產生對齊控制信號,所述控制信號包括向所述多路寄存選擇控制單元發送的相位值,以及向所述符號脈沖產生器發送的偏移值,其中,S/m的整數部分加1為所述偏移值,S/m的余數部分為所述相位值,所述S為接收到的串行序列與預設的參考序列相比的時延偏移,所述接收到的串行序列被分為m路序列;所述多路寄存選擇控制單元用于依據所述相位值,產生所述m路傳輸路徑的選擇信號,所述m路傳輸路徑的選擇信號的二進制拼接值為2(m-P)-1,其中,P為所述相位值;所述m路傳輸路徑中的任意一條傳輸路徑用于傳輸所述m路序列中的一路序列,所述m路傳輸路徑中的任意一條傳輸路徑與其它傳輸路徑傳輸的序列不同;所述任意一條傳輸路徑在接收到的選擇信號為第一數值的情況下,輸出接收到的序列,在接收到的選擇信號為第二數值的情況下,將所述接收到的序列延遲一個采樣點后輸出;所述符號脈沖產生器用于將預先設置的脈沖發射時間延遲t個采樣點后,發出脈沖信號,t為所述偏移值;所述存儲單元用于在接收到所述脈沖信號后,存儲所述m路傳...

    【專利技術屬性】
    技術研發人員:李陽林灝勛
    申請(專利權)人:華為技術有限公司
    類型:發明
    國別省市:廣東,44

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