【技術(shù)實(shí)現(xiàn)步驟摘要】
本專利技術(shù)屬于軟件，涉及模擬信號(hào)轉(zhuǎn)數(shù)字技術(shù)；具體涉及一種模擬數(shù)據(jù)高速采集方法及裝置。
技術(shù)介紹
1、模數(shù)轉(zhuǎn)換器采集模擬電壓信號(hào)，將模擬電壓信號(hào)轉(zhuǎn)化為數(shù)字信號(hào)，方便中央處理器讀取數(shù)字信號(hào)進(jìn)行分析處理，采用多個(gè)并行adc同時(shí)采集傳輸，可以提高數(shù)據(jù)速度，隨著adc采樣速率的不斷提高，數(shù)據(jù)的吞吐量也越來(lái)越大，對(duì)于500msps以上的adcc，動(dòng)輒上升到數(shù)g甚至10g以上的數(shù)據(jù)吞吐率，而采用傳統(tǒng)的cmos和lvds（低壓差分信號(hào)）已經(jīng)很難滿足設(shè)計(jì)要求。
2、有多種新架構(gòu)可以提高模擬數(shù)據(jù)傳輸轉(zhuǎn)化后的采集速率，例如jesd204b等基于高速串行數(shù)據(jù)傳輸接口，最高支持12.5gbps的串行數(shù)據(jù)速率。但模擬數(shù)據(jù)轉(zhuǎn)化后前端處理由于數(shù)據(jù)量龐大，各個(gè)adc匯總后需要進(jìn)行分幀和傳輸，前端處理過(guò)程限制了傳輸速度。
技術(shù)實(shí)現(xiàn)思路
1、為克服現(xiàn)有技術(shù)的缺陷，本專利技術(shù)公開了一種模擬數(shù)據(jù)高速采集方法及裝置。
2、本專利技術(shù)所述模擬數(shù)據(jù)高速采集方法，包括如下步驟：
3、s1.設(shè)定鏈路配置參數(shù)，包括設(shè)置計(jì)數(shù)標(biāo)準(zhǔn)，以及字符標(biāo)記時(shí)的字節(jié)替換規(guī)則；
4、s2.模擬數(shù)據(jù)通過(guò)m個(gè)并行adc轉(zhuǎn)化為數(shù)字信號(hào)；
5、s3.數(shù)字信號(hào)篩選和標(biāo)記
6、s31.數(shù)據(jù)篩選模塊進(jìn)行數(shù)字信號(hào)篩選，對(duì)前m1位不全為零的數(shù)據(jù)進(jìn)行單獨(dú)傳送；直接發(fā)送到同步模塊；
7、s32.?對(duì)前m1位全為零的數(shù)據(jù)，輸入到字符標(biāo)記生成器進(jìn)行字符標(biāo)記，標(biāo)記字節(jié)記為k1；
8、s4
9、所述同步序列信號(hào)由外部時(shí)鐘信號(hào)輸入到同步計(jì)數(shù)器，由同步計(jì)數(shù)器根據(jù)設(shè)定的計(jì)數(shù)標(biāo)準(zhǔn)生成。
10、s5.完成同步和拼接后的數(shù)據(jù)輸入校驗(yàn)?zāi)K進(jìn)行校驗(yàn)，校驗(yàn)規(guī)則包括各幀的首段校驗(yàn)，檢驗(yàn)各幀前m1位為標(biāo)記字節(jié)k1或不全為零，符合則進(jìn)入下一步驟；不符合則中止傳輸；
11、s6.檢測(cè)各幀的首段，發(fā)現(xiàn)連續(xù)出現(xiàn)m3個(gè)前m1位為標(biāo)記字節(jié)k1的數(shù)據(jù)，則認(rèn)為開始接收到有效的數(shù)字信號(hào)，進(jìn)入下一步驟，m3為自定義的啟動(dòng)幀數(shù)；
12、s7.傳輸數(shù)據(jù)
13、在初始同步序列生成模塊內(nèi)設(shè)置初始通道同步序列，初始通道同步序列包括多個(gè)多通道同步幀組成，每個(gè)通道同步幀包括幀對(duì)齊字符，其中一個(gè)通道同步幀包括鏈路配置字符，所述鏈路配置字符后的數(shù)據(jù)直到幀結(jié)束為鏈路配置參數(shù)；
14、初始通道同步序列設(shè)置完成后，首先傳輸初始通道同步序列，然后傳輸步驟s6接收到的數(shù)據(jù)，直至數(shù)據(jù)傳輸完成。
15、優(yōu)選的，所述s31和/或s32步驟中通過(guò)擾碼器對(duì)數(shù)字信號(hào)數(shù)據(jù)中特定位置的m2位進(jìn)行反相擾碼操作。
16、優(yōu)選的，所述s4步驟中所述同步序列信號(hào)由外部時(shí)鐘信號(hào)輸入到同步計(jì)數(shù)器，由同步計(jì)數(shù)器根據(jù)設(shè)定的計(jì)數(shù)標(biāo)準(zhǔn)生成。
17、優(yōu)選的，所述步驟6中通過(guò)監(jiān)控對(duì)齊模塊實(shí)時(shí)監(jiān)控?cái)?shù)據(jù)的標(biāo)記字節(jié)，對(duì)齊數(shù)據(jù)。
18、優(yōu)選的，傳輸數(shù)據(jù)速率lr計(jì)算公式如下：
19、
20、本專利技術(shù)還公開了一種模擬數(shù)據(jù)高速采集裝置，包括多個(gè)并行adc，及與其連接的數(shù)據(jù)傳輸采集器，所述數(shù)據(jù)采集器包括與并行adc連接的數(shù)據(jù)篩選模塊，所述數(shù)據(jù)篩選模塊的兩個(gè)輸出端分別連接字符標(biāo)記生成器和同步拼接模塊，其中字符標(biāo)記模塊輸出端與所述同步拼接模塊連接，同步拼接模塊和字符標(biāo)記生成器還與校驗(yàn)?zāi)K連接，所述校驗(yàn)?zāi)K輸出端連接數(shù)據(jù)傳輸模塊，所述數(shù)據(jù)傳輸模塊還連接有監(jiān)控對(duì)齊模塊與初始同步序列生成模塊，所述數(shù)據(jù)傳輸采集器還包括同步計(jì)數(shù)器，所述同步計(jì)數(shù)器與同步拼接模塊和初始同步序列生成模塊。
21、優(yōu)選的，所述數(shù)據(jù)篩選模塊其中一個(gè)或兩個(gè)輸出端通過(guò)擾碼器連接字符標(biāo)記生成器和同步拼接模塊。
22、優(yōu)選的，所述數(shù)據(jù)傳輸采集器，通過(guò)可編程邏輯器件fpga或數(shù)字信號(hào)處理器dsp編程實(shí)現(xiàn)。
23、本專利技術(shù)所述模擬數(shù)據(jù)高速采集方法及裝置，針對(duì)模擬數(shù)據(jù)轉(zhuǎn)化特點(diǎn)，通過(guò)設(shè)置字節(jié)替換，可以實(shí)現(xiàn)分路快速傳輸，不再需要額外增加標(biāo)記字節(jié)用于識(shí)別和幀對(duì)齊，可以提高數(shù)據(jù)傳輸速度。
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1.模擬數(shù)據(jù)高速采集方法，其特征在于，包括如下步驟：
2.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，所述S31和/或S32步驟中通過(guò)擾碼器對(duì)數(shù)字信號(hào)數(shù)據(jù)中特定位置的M2位進(jìn)行反相擾碼操作。
3.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，所述S4步驟中所述同步序列信號(hào)由外部時(shí)鐘信號(hào)輸入到同步計(jì)數(shù)器，由同步計(jì)數(shù)器根據(jù)設(shè)定的計(jì)數(shù)標(biāo)準(zhǔn)生成。
4.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，所述步驟6中通過(guò)監(jiān)控對(duì)齊模塊實(shí)時(shí)監(jiān)控?cái)?shù)據(jù)的標(biāo)記字節(jié)，對(duì)齊數(shù)據(jù)。
5.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，傳輸數(shù)據(jù)速率LR計(jì)算公式如下：
6.模擬數(shù)據(jù)高速采集裝置，其特征在于，包括多個(gè)并行ADC，及與其連接的數(shù)據(jù)傳輸采集器，所述數(shù)據(jù)采集器包括與并行ADC連接的數(shù)據(jù)篩選模塊，所述數(shù)據(jù)篩選模塊的兩個(gè)輸出端分別連接字符標(biāo)記生成器和同步拼接模塊，其中字符標(biāo)記模塊輸出端與所述同步拼接模塊連接，同步拼接模塊和字符標(biāo)記生成器還與校驗(yàn)?zāi)K連接，所述校驗(yàn)?zāi)K輸出端連接數(shù)據(jù)傳輸模塊，所述數(shù)據(jù)傳輸模塊還連接有監(jiān)控對(duì)齊模塊與初
7.如權(quán)利要求6所述的模擬數(shù)據(jù)高速采集裝置，其特征在于，所述數(shù)據(jù)篩選模塊其中一個(gè)或兩個(gè)輸出端通過(guò)擾碼器連接字符標(biāo)記生成器和同步拼接模塊。
8.如權(quán)利要求6所述的模擬數(shù)據(jù)高速采集裝置，其特征在于，所述數(shù)據(jù)傳輸采集器，通過(guò)可編程邏輯器件FPGA或數(shù)字信號(hào)處理器DSP編程實(shí)現(xiàn)。
...【技術(shù)特征摘要】
1.模擬數(shù)據(jù)高速采集方法，其特征在于，包括如下步驟：
2.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，所述s31和/或s32步驟中通過(guò)擾碼器對(duì)數(shù)字信號(hào)數(shù)據(jù)中特定位置的m2位進(jìn)行反相擾碼操作。
3.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，所述s4步驟中所述同步序列信號(hào)由外部時(shí)鐘信號(hào)輸入到同步計(jì)數(shù)器，由同步計(jì)數(shù)器根據(jù)設(shè)定的計(jì)數(shù)標(biāo)準(zhǔn)生成。
4.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，所述步驟6中通過(guò)監(jiān)控對(duì)齊模塊實(shí)時(shí)監(jiān)控?cái)?shù)據(jù)的標(biāo)記字節(jié)，對(duì)齊數(shù)據(jù)。
5.如權(quán)利要求1所述的模擬數(shù)據(jù)高速采集方法，其特征在于，傳輸數(shù)據(jù)速率lr計(jì)算公式如下：
6.模擬數(shù)據(jù)高速采集裝置，其特征在于，包括多個(gè)并行adc，及與其連接的數(shù)據(jù)傳...
【專利技術(shù)屬性】
技術(shù)研發(fā)人員：陳才剛，趙萱坤，景陽(yáng)，
申請(qǐng)(專利權(quán))人：蘇州賽邁測(cè)控技術(shù)有限公司，
類型：發(fā)明
國(guó)別省市：
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