【技術實現步驟摘要】
本公開的實施例涉及集成電路，并且特別涉及處理器、指令處理方法以及包括處理器的電子裝置。
技術介紹
1、中央處理單元（central?processing?unit，cpu）的加速器單元（acceleratorunit，或簡稱“加速器”）通常指的是能夠提升cpu在特定應用領域的計算能力的技術，例如，在特定應用領域提升cpu的處理速度和效率的技術。集成在cpu內的加速器單元，根據與cpu核心（core）的連接關系，一般分為cpu核心內部加速器和cpu核心外部加速器兩種。
2、然而，cpu加速器可能存在加速器單元利用率低或者負載卸載開銷大的問題。
技術實現思路
1、根據本公開的至少一實施例提供了一種處理器，包括：多個處理器核心，其中，所述多個處理器核心中的每個被配置為執行第一類指令；加速器模塊，其中，所述加速器模塊包括至少一個加速器引擎，被配置為執行不同于所述第一類指令的第二類指令；其中，所述加速器模塊與所述多個處理器核心耦接并且由所述多個處理器核心共享，所述多個處理器核心分別將自身所處理的指令流中屬于所述第二類指令的對象指令派發到所述加速器模塊執行并且從所述加速器模塊接收所述對象指令的執行結果消息。
2、例如，根據本公開的實施例的處理器，其中：所述加速器模塊動態地耦接到所述多個處理器核心，從所述多個處理器核心接收屬于所述第二類指令的相同或不同的對象指令。
3、例如，根據本公開的實施例的處理器，其中，所述多個處理器核心中的每個還被配置為：識別所述指令流
4、例如，根據本公開的實施例的，其中，所述多個處理器核心中的每個還被配置為：使所述對象指令進入派發隊列以等待派發，針對所述對象指令在重排序緩沖區（reorderbuffer，rob）中分配條目（entry），以及響應于所述對象指令成為所述rob中最老的指令，向所述加速器模塊派發所述對象指令。
5、例如，根據本公開的實施例的處理器，其中，所述多個處理器核心中的每個還被配置為：使所述對象指令進入派發隊列以等待派發，等待重排序緩沖區rob排空，以及響應于所述rob排空，向所述加速器模塊派發所述指令。
6、例如，根據本公開的實施例的處理器，其中：所述加速器模塊還被配置為向對應的處理器核心返回所述對象指令的處理結果，并且所述對象指令的執行結果消息包括所述對象指令的執行結果；或者所述加速器模塊還被配置為將所述對象指令的處理結果存儲到與所述多個處理器核心耦接的存儲器中，并且所述對象指令的執行結果消息包括所述對象指令的執行結果在所述存儲器中的存儲地址。
7、例如，根據本公開的實施例的處理器，其中，所述多個處理器核心中的每個處理器核心包括：取指模塊，被配置為獲取指令；解碼模塊，被配置為將獲取的指令解碼為一個或多個微操作mop；以及派發模塊，被配置為向處理器核心流水線或所述加速器模塊派發所述一個或多個mop。
8、例如，根據本公開的實施例的處理器，其中，所述一個或多個mop包括：讀取和填充mop，用于讀取指令參數并填充操作數，負載卸載mop，用于向執行所述一個或多個mop的加速器引擎下發工作負載。
9、例如，根據本公開的實施例的處理器，其中，響應于所述加速器引擎與對應的處理器核心處于同步操作模式，所述加速器模塊被配置為響應于所述對象指令在所述加速器模塊中執行結束，向所述對應的處理器核心返回執行狀態。
10、例如，根據本公開的實施例的處理器，其中，所述一個或多個mop還包括：讀取響應mop，用于使所述至少一個加速器引擎向對應的處理器核心返回執行狀態。
11、例如，根據本公開的實施例的處理器，其中，所述加速器模塊還包括：仲裁器，耦接在所述多個處理器核心與至少一個加速器引擎之間，并且被配置為對從所述多個處理器核心接收的所述對象指令進行仲裁以分配給所述至少一個加速器引擎中的目標加速器引擎。
12、例如，根據本公開的實施例的處理器，其中，所述加速器模塊還包括：存儲器接口，與所述至少一個加速器引擎耦接并且包括轉譯后備緩沖器（translation?lookasidebuffer，tlb），其中，所述至少一個加速器引擎共享所述tlb。
13、例如，根據本公開的實施例的處理器，其中，所述tlb包括一個或多個tlb條目，所述一個或多個tlb條目中的每一個包括處理器核心id，所述處理器核心身份標識（id）標識用于當前的tlb條目屬于所述多個處理器核心中的哪個處理器核心。
14、例如，根據本公開的實施例的處理器，其中，所述一個或多個tlb條目中的每一個還包括：進程id，用于標識用于當前的tlb條目所屬于的進程。
15、例如，根據本公開的實施例的處理器，其中，所述多個處理器核心中的每個還被配置為向所述加速器模塊發送tlb條目操作指令，所述tlb條目操作指令在被執行時使得所述加速器模塊執行以下操作中的一個或多個：無效所有tlb條目，無效具有特定進程id的tlb條目，無效具有特定進程id和特定虛擬頁號（vpn）的tlb條目，無效具有特定處理器核心id的tlb條目，無效具有特定處理器核心id和特定進程id的tlb條目，無效具有特定處理器核心id、特定進程id以及特定vpn的tlb條目。
16、例如，根據本公開的實施例的處理器，其中，所述加速器模塊還包括數據緩存，并且其中，所述多個處理器核心中的每個還被配置為向所述加速器模塊發送緩存操作指令，所述緩存操作指令在被執行時使得所述加速器模塊執行以下操作中的一個或多個：無效所述數據緩存中的所有緩存行；無效所述數據緩存中的一個或多個緩存行；刷新所述數據緩存中的所有緩存行；以及刷新所述數據緩存中的一個或多個緩存行。
17、例如，根據本公開的實施例的處理器，其中，所述至少一個加速器引擎包括控制寄存器，所述控制寄存器被配置為存儲所述tlb條目操作指令和所述緩存操作指令。
18、例如，根據本公開的實施例的處理器，其中，所述加速器模塊還包括與所述多個處理器核心獨立的頁表遍歷器（page?table?walker，ptw），其中，所述加速器模塊還被配置為：響應于所述至少一個加速器引擎針對所述tlb發生未命中（miss），使用所述獨立的ptw完成頁表訪問。
19、例如，根據本公開的實施例的處理器，其中，所述加速器模塊還包括連接到所述多個處理器核心中至少一部分的ptw路由器，所述對象指令還包括處理器核心id，其中，所述加速器模塊還被配置為：響應于所述至少一個加速器引擎針對所述tlb發生未命中，使用所述ptw路由器基于所述處理器核心id訪問對應的處理器核心中的ptw，以完成頁表訪問。
20、例如，根據本公開的實施例的處理器，其中，所述至少一個加速器引擎中本文檔來自技高網...
【技術保護點】
1.一種處理器，包括：
2.根據權利要求1所述的處理器，其中：
3.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個還被配置為：
4.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個還被配置為：
5.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個還被配置為：
6.根據權利要求1所述的處理器，其中：
7.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個處理器核心包括：
8.根據權利要求7所述的處理器，其中，所述一個或多個微操作包括：
9.根據權利要求1所述的處理器，其中，響應于所述加速器引擎與對應的處理器核心處于同步操作模式，所述加速器模塊被配置為響應于所述對象指令在所述加速器模塊中執行結束，向所述對應的處理器核心返回執行狀態。
10.根據權利要求8所述的處理器，其中，所述一個或多個微操作還包括：
11.根據權利要求1所述的處理器，其中，所述加速器模塊還包括：
12.根據權利要求1所述的處理器，其中，所
13.根據權利要求12所述的處理器，其中，所述轉譯后備緩沖器包括一個或多個轉譯后備緩沖器條目，
14.根據權利要求13所述的處理器，其中，所述一個或多個轉譯后備緩沖器條目中的每一個還包括：
15.根據權利要求14所述的處理器，其中，所述多個處理器核心中的每個還被配置為向所述加速器模塊發送轉譯后備緩沖器條目操作指令，所述轉譯后備緩沖器條目操作指令在被執行時使得所述加速器模塊執行以下操作中的一個或多個：
16.根據權利要求15所述的處理器，其中，所述加速器模塊還包括數據緩存，并且
17.根據權利要求16所述的處理器，其中，所述至少一個加速器引擎包括控制寄存器，
18.根據權利要求1所述的處理器，其中，所述加速器模塊還包括與所述多個處理器核心獨立的頁表遍歷器，
19.根據權利要求1所述的處理器，其中，所述加速器模塊還包括連接到所述多個處理器核心中至少一部分的頁表遍歷器路由器，所述對象指令還包括處理器核心身份標識，
20.根據權利要求11所述的處理器，其中，所述至少一個加速器引擎中的每一個包括：
21.根據權利要求20所述的處理器，其中，所述獲取前端模塊包括負載卸載緩沖區，所述負載卸載緩沖區被配置為存儲對象指令參數和操作數。
22.一種電子裝置，包括根據權利要求1-21中任一項所述的處理器。
23.一種指令處理方法，包括：
...【技術特征摘要】
1.一種處理器，包括：
2.根據權利要求1所述的處理器，其中：
3.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個還被配置為：
4.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個還被配置為：
5.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個還被配置為：
6.根據權利要求1所述的處理器，其中：
7.根據權利要求1所述的處理器，其中，所述多個處理器核心中的每個處理器核心包括：
8.根據權利要求7所述的處理器，其中，所述一個或多個微操作包括：
9.根據權利要求1所述的處理器，其中，響應于所述加速器引擎與對應的處理器核心處于同步操作模式，所述加速器模塊被配置為響應于所述對象指令在所述加速器模塊中執行結束，向所述對應的處理器核心返回執行狀態。
10.根據權利要求8所述的處理器，其中，所述一個或多個微操作還包括：
11.根據權利要求1所述的處理器，其中，所述加速器模塊還包括：
12.根據權利要求1所述的處理器，其中，所述加速器模塊還包括：
13.根據權利要求12所述的處理器，其中，所述轉譯后備緩沖器包括一個或多個轉譯后備緩沖器條目，
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【專利技術屬性】
技術研發人員：張偉，崔澤漢，
申請(專利權)人：海光信息技術股份有限公司，
類型：發明
國別省市：
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