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    基于UVM環境的用于驗證I2C協議的驗證平臺、方法及系統技術方案

    技術編號:44030640 閱讀:12 留言:0更新日期:2025-01-15 01:11
    本申請實施例公開了一種基于UVM環境的用于驗證I2C協議的驗證平臺、方法及系統,涉及功能驗證領域。本申請的UVM環境具有全面參數化配置能力,動態匹配多樣測試場景,確保了驗證的全方位覆蓋與深入洞察。智能模式切換機制,無縫對接DUT角色變化,提升了驗證流程的自動化與效率。隨機化測試策略引入,顯著增強了驗證的隨機性與魯棒性,有效揭露潛在問題。作為標準I2C器件模擬,環境獨立執行時序驗證,精準捕捉并分析通信異常,加速故障定位。SystemVerilog與UVM的融合應用,簡化了驗證復雜度,優化了仿真流程,縮短了迭代周期。

    【技術實現步驟摘要】

    本申請涉及功能驗證領域,尤其涉及一種基于uvm環境的用于驗證i2c協議的驗證平臺、方法及系統。


    技術介紹

    1、i2c(inter-integrated?circuit),作為一種高度集成化的同步串行通信總線技術,自1980年代由飛利浦公司創立以來,便憑借其僅依賴時鐘線(scl)與數據線(sda)的獨特架構,實現了多主機與多從機間的靈活通信,并內置了高效的仲裁機制。這兩條雙向io線路—時鐘線與數據線,均設計為開漏(open?drain)接口,需借助外部上拉電阻連接至電源,以確保在無活動狀態時維持高電平狀態。當i2?c總線上的任一設備主動拉低信號至低電平時,總線狀態隨之改變,這一特性確保了數據傳輸的精確控制。

    2、鑒于i2c總線在當代集成電路設計中的廣泛應用,眾多芯片均需遵循i2c協議進行數據交互。為此,業界發展出了一種高效驗證工具—i2c?vip(verification?intellectualproperty),它能夠在行為級進行抽象簡化,同時在信號級實現精確模擬,確保i2c協議下數據收發的準確無誤。

    3、在早期實踐中,基于verilog編寫的i2c模型模塊或直接利用兩個獨立的i2c硬件描述語言(hdl)模塊(一個作為主機,一個作為從機)進行對接收發測試,是常見的驗證手段。然而,這些傳統方法存在局限性:例如,master_model與slave_model通常分置為兩個verilog文件,其中的從機地址、波特率等配置參數多通過parameter定義,這種方式雖便于定向測試,卻難以滿足隨機驗證的廣泛需求,限制了測試的全面性和靈活性。

    4、另一方面,當采用兩個i2c?hdl模塊直接對接進行測試時,若發送與接收邏輯由同一位數字設計工程師設計,可能存在潛在風險:即發送與接收邏輯中隱藏的相同錯誤可能因內部一致性而未被察覺,導致錯誤的相互抵消(而正好能通信),從而掩蓋了實際存在的問題。這種情況凸顯了驗證過程中引入獨立性和多樣性測試策略的重要性,以確保設計的健壯性和可靠性。


    技術實現思路

    1、本申請實施例提供了基于uvm環境的用于驗證i2c協議的驗證平臺、方法及系統,可以解決現有技術中只能實現部分驗證的功能和隨機性較低的問題。所述技術方案如下:

    2、第一方面,本申請實施例提供了一種基于uvm環境的用于驗證i2c協議的驗證平臺,包括:

    3、所述uvm環境包括:主機代理、從機代理、以及計分板,所述主機代理包括:主機序列器、主機監視器和主機驅動器,所述從機代理包括:從機序列器、從機監視器和從機驅動器,所述主機代理和所述從機代理分別與所述計分板進行通信,所述uvm環境通過虛擬intf與dut進行通信;

    4、其中,所述主機序列器,用于將來自序列庫的隨機生成的item傳輸到所述主機驅動器;

    5、所述主機驅動器,用于根據來自所述主機序列器的item,生成并驅動i2c總線上的時鐘線scl和數據線sda信號,包括:起始信號start、停止信號stop、讀寫操作的scl時鐘以及相應的sda數據;

    6、所述主機監視器,用于監控i2c總線上的信號,以及并對sda上的數據進行采樣,將采樣結果打包成item發送給所述計分板;

    7、所述從機序列器,用于將從機相關的隨機測試序列item發送到所述從機驅動器;

    8、所述從機驅動器,用于根據接收到的item,在從機發送階段生成sda數據;

    9、所述從機監視器,用于監控i2c總線上的信號并將接收到的數據或發送的數據采樣打包成item發送給所述計分板;

    10、所述計分板,用于來自所述主機監視器和所述從機監視器的item,并對item中的數據進行對比和分析后輸出統計結果,以驗證i2c總線上的數據傳輸是否按預期進行。

    11、第二方面,本申請實施例提供了一種基于uvm環境的用于驗證i2c協議的驗證方法,包括:

    12、主機序列器將來自序列庫的隨機生成的item傳輸到所述主機驅動器;

    13、所述主機驅動器根據來自所述主機序列器的item,生成并驅動i2c總線上的時鐘線scl和數據線sda信號,包括:起始信號start、停止信號stop、讀寫操作的scl時鐘以及相應的sda數據;

    14、主機監視器監控i2c總線上的信號,以及并對sda上的數據進行采樣,將采樣結果打包成item發送給計分板;

    15、所述從機序列器將從機相關的隨機測試序列item發送到從機驅動器;

    16、所述從機驅動器接收到的item,在從機發送階段生成sda數據;

    17、從機監視器監控i2c總線上的信號并將接收到的數據或發送的數據采樣打包成item發送給所述計分板;

    18、所述計分板來自所述主機監視器和所述從機監視器的item,并對item中的數據進行對比和分析后輸出統計結果,以驗證i2c總線上的數據傳輸是否按預期進行。

    19、本申請一些實施例提供的技術方案帶來的有益效果至少包括:

    20、在dut分別扮演i2c從機與主機角色時,uvm驗證環境能夠智能識別并自動調整其內部機制,實現從固定模式向動態適配的轉變。通過參數化配置dut的特定屬性(如從機地址、地址位寬等),驗證環境能夠無縫對接,自動切換至對應的從機模式或主機模式,從而執行相應的通信協議與時序檢查,顯著提升了驗證的靈活性和效率。

    本文檔來自技高網...

    【技術保護點】

    1.一種基于UVM環境的用于驗證I2C協議的驗證平臺,其特征在于,包括:

    2.根據權利要求1所述的方法,其特征在于,所述主機驅動器并行運行如下的任務:driver_ctrl任務、driver_clk任務、driver_data任務以及err_det任務;

    3.根據權利要求1所述的方法,其特征在于,所述序列庫利用隨機約束機制生成每次I2C傳輸所需的配置參數,配置參數包括地址位寬、地址值、傳輸類型和數據量。

    4.根據權利要求1所述的方法,其特征在于,所述統計結果包括:錯誤數量和通過率。

    5.根據權利要求1所述的方法,其特征在于,對DUT的配置是通過APB接口進行操作。

    6.一種基于UVM環境的用于驗證I2C協議的驗證方法,其特征在于,包括:

    7.一種驗證平臺,其特征在于,包括:如權利要求1至5任意一項所述的驗證系統。

    【技術特征摘要】

    1.一種基于uvm環境的用于驗證i2c協議的驗證平臺,其特征在于,包括:

    2.根據權利要求1所述的方法,其特征在于,所述主機驅動器并行運行如下的任務:driver_ctrl任務、driver_clk任務、driver_data任務以及err_det任務;

    3.根據權利要求1所述的方法,其特征在于,所述序列庫利用隨機約束機制生成每次i2c傳輸所需的配置參數,配置參數包括地址...

    【專利技術屬性】
    技術研發人員:陳奉儀,彭陳,吳亞杰,楊鋼肖云飛,方婉,林浩強,曹定煜劉文,蔡京谷,徐鈺珊,吳振海
    申請(專利權)人:珠海泰為電子有限公司
    類型:發明
    國別省市:

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