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【技術實現步驟摘要】
本申請涉及計算機,尤其涉及一種可編程控制器、電子設備及控制方法。
技術介紹
1、目前,在計算機執行各項計算任務時,需要各種功能模塊的支持,如處理器內核、總線、鎖相環、內存等。
2、如果計算機持續執行各項計算任務,會使得處理器持續處于運行狀態,導致計算機的功耗較高。
技術實現思路
1、有鑒于此,本申請提供一種可編程控制器、電子設備及控制方法,如下:
2、一種可編程控制器,包括:
3、傳輸組件和延遲控制組件;
4、其中,所述傳輸組件用于接收針對處理器的請求;
5、所述延遲控制組件用于監測是否到達喚醒周期,在所述喚醒周期到達的情況下,控制所述傳輸組件將所述請求發送給所述處理器,以使得所述處理器在所述喚醒周期內處理所述請求;
6、其中,在所述喚醒周期沒有到達的情況下,所述處理器處于第一狀態,在所述喚醒周期到達的情況下,所述處理器處于第二狀態;所述處理器在所述第一狀態下的功耗低于所述處理器在所述第二狀態下的功耗。
7、上述可編程控制器,優選的,所述喚醒周期到達,包括:
8、第一數量到達預設的目標數量;
9、其中,所述第一數量為:所述處理器在所述第一狀態上所經歷的時鐘節拍的數量。
10、上述可編程控制器,優選的,所述時鐘節拍為目標部件的時鐘節拍,所述目標部件為從多個具有時鐘節拍的部件中所選擇的部件;
11、其中,通過以下結構選擇所述目標部件的時鐘節拍:
13、其中,每個所述第一與門的第一輸入端口連接一個時鐘節拍提供源,所述時鐘節拍提供源來源于具有時鐘節拍的部件,每個所述第一與門的第二輸入端口為使能端口,所述使能端口在接收到使能信號的情況下被使能,所述使能端口被使能的第一與門所連接的部件為所述目標部件;
14、每個所述第一與門的輸出端口連接到所述第一輸出結構,所述第一輸出結構連接所述延遲控制組件,以使得所述第一輸出結構將所述目標部件的時鐘節拍提供給所述延遲控制組件。
15、上述可編程控制器,優選的,所述延遲控制組件包括:
16、輸入結構、第一組件和第二組件;
17、其中,所述輸入結構用于接收所述傳輸組件發送的請求;
18、所述第一組件用于獲得所述請求對應的延遲參數;
19、所述第二組件用于根據所述延遲參數,獲得所述請求對應的延遲周期數量;監測是否到達喚醒周期,在所述喚醒周期到達且所述喚醒周期與所述延遲周期數量相匹配的情況下,控制所述傳輸組件將所述請求發送給所述處理器,以使得所述處理器在所述喚醒周期內處理所述請求。
20、上述可編程控制器,優選的,還包括:激活組件;
21、其中,所述激活組件連接所述延遲控制組件;所述延遲控制組件還用于在所述喚醒周期到達的情況下,控制所述激活組件向任務執行部件發送激活信號,以使得所述任務執行部件在所述喚醒周期內執行所述請求對應的任務。
22、上述可編程控制器,優選的,所述激活組件包括:
23、第二輸出結構和多個第二與門;
24、其中,每個所述第二與門的第一輸入端口分別連接一個信號源,每個所述信號源對應于一個任務執行部件,所述信號源提供其對應的任務執行部件的激活信號,每個所述第二與門的第二輸入端口為使能端口,且,所述使能端口連接所述第二組件,所述使能端口在接收到所述第二組件傳輸的使能信號的情況下被使能;
25、每個所述第二與門的輸出端口分別連接所述第二輸出結構,所述第二輸出結構連接所述任務執行部件,所述激活組件將所述使能端口被使能的第二與門對應的激活信號傳輸給對應的任務執行部件,以使得所述任務執行部件在所述喚醒周期內執行所述請求對應的任務。
26、上述可編程控制器,優選的,其中:
27、在所述請求為多個的情況下,所述延遲控制組件控制所述傳輸組件按照處理順序將所述請求發送給所述處理器,以使得所述處理器按照所述處理順序處理所述請求,所述處理順序與所述請求對應的到達順序和/或請求優先級相關;
28、和/或,在所述請求為多個,且對應于同一任務執行部件的情況下,所述延遲控制組件使能所述任務執行部件對應的使能端口,以使得所述任務執行部件按照所述任務順序執行每個所述請求對應的任務;所述任務順序至少與所述請求對應的任務優先級相關;
29、和/或,在所述請求為多個,且對應于不同的任務執行部件的情況下,所述延遲控制組件同步或者按照所述任務順序依次使能每個所述任務執行部件對應的使能端口,以使得每個所述任務執行部件按照所述任務順序執行相應請求對應的任務;所述任務順序至少與所述請求對應的任務優先級相關。
30、上述可編程控制器,優選的,所述傳輸組件包括:
31、至少一個切換組件,所述切換組件至少包括第一輸入端口、第二輸入端口、第一輸出端口和第二輸出端口;
32、其中,所述第一輸入端口用于接收所述請求;所述第一輸入端口在第一指令下連接所述第一輸出端口,所述第一輸出端口連接所述延遲控制組件;所述第一指令用于指示延遲所述請求;
33、所述第二輸入端口連接所述延遲控制組件,所述第二輸入端口連接所述第二輸出端口,所述第二輸出端口連接所述處理器。
34、上述可編程控制器,優選的,所述傳輸組件還包括:
35、第三輸出結構,所述第三輸出結構連接所述處理器;
36、其中,所述切換組件還包括:
37、第三輸出端口;所述第三輸出端口連接所述第三輸出結構;且,所述第一輸入端口在第二指令下連接所述第三輸出端口;所述第二指令用于指示不延遲所述請求。
38、上述可編程控制器,優選的,在所述喚醒周期達到之后,在所述傳輸組件接收到針對所述處理器的新請求的情況下,所述延遲控制組件判斷處理條件是否被滿足;如果所述處理條件被滿足,控制所述傳輸組件將所述新請求發送給所述處理器,以使得所述處理器在所述喚醒周期內處理所述新請求;
39、如果所述處理條件沒有被滿足,所述延遲控制組件控制所述傳輸組件將所述新請求在所述喚醒周期對應的后續喚醒周期內發送給所述處理器,以使得所述處理器在所述喚醒周期對應的后續喚醒周期內處理所述新請求;
40、其中,所述處理條件,包括:所述新請求被處理所需的節拍數量小于或等于所述喚醒周期的剩余節拍數量。
41、一種電子設備,至少包括:
42、可編程控制器、處理器和目標部件;所述目標部件為所述可編程控制器提供時鐘節拍;
43、其中,所述可編程控制器包括:傳輸組件和延遲控制組件;
44、所述傳輸組件用于接收針對所述處理器的請求;
45、所述延遲控制組件用于監測是否到達喚醒周期,在所述喚醒周期到達的情況下,控制所述傳輸組件將所述請求發送給所述處理器,以使得所述處理器在所述喚醒周期內處理所本文檔來自技高網...
【技術保護點】
1.一種可編程控制器,包括:
2.根據權利要求1所述的可編程控制器,所述時鐘節拍為目標部件的時鐘節拍,所述目標部件為從多個具有時鐘節拍的部件中所選擇的部件;
3.根據權利要求1或2所述的可編程控制器,所述延遲控制組件包括:
4.根據權利要求3所述的可編程控制器,還包括:激活組件;
5.根據權利要求4所述的可編程控制器,所述激活組件包括:
6.根據權利要求4所述的可編程控制器,其中:
7.根據權利要求1或2所述的可編程控制器,所述傳輸組件包括:
8.根據權利要求7所述的可編程控制器,所述傳輸組件還包括:
9.根據權利要求1或2所述的可編程控制器,在所述喚醒周期達到之后,在所述傳輸組件接收到針對所述處理器的新請求的情況下,所述延遲控制組件判斷處理條件是否被滿足;如果所述處理條件被滿足,控制所述傳輸組件將所述新請求發送給所述處理器,以使得所述處理器在所述喚醒周期內處理所述新請求;
10.一種電子設備,至少包括:
11.根據權利要求10所述的電子設備,還包括;
< ...【技術特征摘要】
1.一種可編程控制器,包括:
2.根據權利要求1所述的可編程控制器,所述時鐘節拍為目標部件的時鐘節拍,所述目標部件為從多個具有時鐘節拍的部件中所選擇的部件;
3.根據權利要求1或2所述的可編程控制器,所述延遲控制組件包括:
4.根據權利要求3所述的可編程控制器,還包括:激活組件;
5.根據權利要求4所述的可編程控制器,所述激活組件包括:
6.根據權利要求4所述的可編程控制器,其中:
7.根據權利要求1或2所述的可編程控制器,所述傳輸組件包括:
...【專利技術屬性】
技術研發人員:杜夢昕,
申請(專利權)人:鼎道智芯上海半導體有限公司,
類型:發明
國別省市:
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