【技術實現步驟摘要】
【技術保護點】
一種可減小過沖和抖動的時鐘占空比校正電路，其特征在于，包括：第一DCC延遲鏈，用于接收第一時鐘信號并生成第二時鐘信號；第二DCC延遲鏈，用于接收第二時鐘信號并生成第三時鐘信號；DCC鑒相器，用于接收第一時鐘信號和第三時鐘信號并經過相位比較輸出增加或減少延遲鏈長度的信號；DCC邏輯控制電路，用于接收增加或減少延遲鏈長度的信號并分別控制第一DCC延遲鏈或第二DCC延遲鏈。
【技術特征摘要】
【專利技術屬性】
技術研發人員：亞歷山大，劉成，
申請(專利權)人：西安華芯半導體有限公司，
類型：發明
國別省市：
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