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本文描述的某些實例涉及一種允許處理單元高效地執(zhí)行密碼運算的協(xié)處理器。所述協(xié)處理器具有算術(shù)單元，所述算術(shù)單元被配置為使用從存儲器加載的位序列來執(zhí)行離散二進制算術(shù)。所述協(xié)處理器可被配置用于某些函數(shù)的快速低功率計算，所述函數(shù)包括用于密碼運算的低級...該專利屬于PQ盾牌有限公司所有，僅供學(xué)習(xí)研究參考，未經(jīng)過PQ盾牌有限公司授權(quán)不得商用。